太阳城集团

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延迟元件及数字控制振荡器.pdf

摘要
申请专利号:

太阳城集团CN201110306286.2

申请日:

2011.09.26

公开号:

CN102931983B

公开日:

2015.01.14

当前法律状态:

有效性:

法律详情: 授权|||实质审查的生效IPC(主分类):H03L 7/099申请日:20110926|||公开
IPC分类号: H03L7/099 主分类号: H03L7/099
申请人: 财团法人交大思源基金会
发明人: 李镇宜; 余建萤; 游佳融
地址: 中国台湾新竹市大学路1001号
优先权: 2011.08.11 TW 100128747
专利代理机构: 上海专利商标事务所有限公司 31100 代理人: 陆勍
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法律状态
申请(专利)号:

太阳城集团CN201110306286.2

授权太阳城集团号:

102931983B||||||

法律状态太阳城集团日:

2015.01.14|||2013.03.20|||2013.02.13

法律状态类型:

太阳城集团授权|||实质审查的生效|||公开

摘要

一种延迟元件包含第一反相晶体管对、第二反相晶体管对以及数个延迟单元。第一反相晶体管对用以接收输入信号。第二反相晶体管对交错耦接第一反相晶体管对,并由第一反相晶体管对交错控制。延迟单元分别迭接于第一反相晶体管对之间以及第二反相晶体管对之间,用以提供连续的数个信号传递延迟,其中输入信号经由第一反相晶体管对、第二反相晶体管对与延迟单元依序操作而延迟预设太阳城集团,以产生相对应预设太阳城集团的输出信号。一种数字控制振荡器亦于此揭露。

权利要求书

权利要求书一种延迟元件,包含:
一第一反相晶体管对,用以接收一输入信号;
一第二反相晶体管对,交错耦接该第一反相晶体管对,并由该第一反相晶体管对交错控制;以及
数个延迟单元,分别迭接于该第一反相晶体管对之间以及该第二反相晶体管对之间,用以提供连续的数个信号传递延迟;
其中该输入信号经由该第一反相晶体管对、该第二反相晶体管对与该些延迟单元依序操作而延迟一预设太阳城集团,以产生相对应该预设太阳城集团的一输出信号。
如权利要求1所述的延迟元件,其中该第一反向晶体管对包含:
一第一晶体管,具有一栅极、一漏极以及一源极,该第一晶体管的该栅极电性耦接一输入端,该第一晶体管的该源极电性耦接一相对高电平电压;以及
一第二晶体管,具有一栅极、一漏极以及一源极,该第二晶体管的该栅极电性耦接该输入端,该第二晶体管的该源极电性耦接一相对低电平电压;
其中该第一晶体管为一P型晶体管,该第二晶体管为一N型晶体管。
如权利要求2所述的延迟元件,其中该第二反向晶体管对包含:
一第三晶体管,具有一栅极、一漏极以及一源极,该第三晶体管的该栅极电性耦接该第二晶体管的该漏极,该第三晶体管的该源极电性耦接该相对高电平电压;以及
一第四晶体管,具有一栅极、一漏极以及一源极,该第四晶体管的该栅极电性耦接该第一晶体管的该漏极,该第四晶体管的该源极电性耦接该相对低电平电压;
其中该第三晶体管为一P型晶体管,该第四晶体管为一N型晶体管。
如权利要求3所述的延迟元件,其中该些延迟单元包含:
一第一迭接晶体管对,迭接于该第一反向晶体管对的该第一晶体管以及该第二晶体管之间,且该第一迭接晶体管对交错耦接该第二反向晶体管对,并由该第二反向晶体管对交错控制;以及
一第二迭接晶体管对,迭接于该第二反向晶体管对的该第三晶体管以及该第四晶体管之间,且该第二迭接晶体管对电性耦接该第一迭接晶体管对以及一输出端,并由该第一迭接晶体管对控制。
如权利要求4所述的延迟元件,其中该第一迭接晶体管对包含:
一第五晶体管,具有一栅极、一漏极以及一源极,该第五晶体管的该栅极电性耦接该第四晶体管的该漏极,该第五晶体管的该源极电性耦接该第一晶体管的该漏极以及该第四晶体管的该栅极;以及
一第六晶体管,具有一栅极、一漏极以及一源极,该第六晶体管的该栅极电性耦接该第三晶体管的该漏极,该第六晶体管的该漏极电性耦接该第五晶体管的该漏极,该第六晶体管的该源极电性耦接该第二晶体管的该漏极以及该第三晶体管的该栅极;
其中该第五晶体管为一P型晶体管,该第六晶体管为一N型晶体管。
如权利要求5所述的延迟元件,其中该第二迭接晶体管对包含:
一第七晶体管,具有一栅极、一漏极以及一源极,该第七晶体管的该栅极电性耦接该第五晶体管以及该第六晶体管的该漏极,该第七晶体管的该漏极电性耦接该输出端,该第七晶体管的该源极电性耦接该第三晶体管的该漏极以及该第六晶体管的该栅极;以及
一第八晶体管,具有一栅极、一漏极以及一源极,该第八晶体管的该栅极电性耦接该第七晶体管的该栅极、该第五晶体管的该漏极以及该第六晶体管的该漏极,该第八晶体管的该漏极电性耦接该第七晶体管的该漏极以及该输出端,该第八晶体管的该源极电性耦接该第四晶体管的该漏极以及该第五晶体管的该栅极;
其中该第七晶体管为一P型晶体管,该第八晶体管为一N型晶体管。
如权利要求6所述的延迟元件,更包含:
一旁路单元,并联耦接该些迭接晶体管对,透过切换该旁路单元至导通状态,以排除该些迭接晶体管对中该P型晶体管以及该N型晶体管的储存电荷。
如权利要求7所述的延迟元件,其中该旁路单元包含数个旁路晶体管,该些旁路晶体管以并联方式或迭接方式相互耦接。
如权利要求3所述的延迟元件,其中该些延迟单元包含:
数个迭接晶体管对,分别迭接于该第一反向晶体管对之间以及该第二反向晶体管对之间,该些迭接晶体管对依序串联相接,该些迭接晶体管对中的第一者交错耦接该第二反向晶体管对,并由该第二反向晶体管对交错控制,该些迭接晶体管对中的最后一者电性耦接一输出端;
其中除了该些迭接晶体管对中最后一者之外,其余该些迭接晶体管对以交错耦接方式串联相接,并依序交错控制。
如权利要求9所述的延迟元件,其中该些迭接晶体管对中的每一者包含一P型晶体管以及一N型晶体管,且该第一反向晶体管对、该第二反向晶体管对以及该些迭接晶体管对中的该P型晶体管以及该N型晶体管以交错方式传递信号。
如权利要求10所述的延迟元件,更包含:
一旁路单元,并联耦接该些迭接晶体管对,透过切换该旁路单元至导通状态,以排除该些迭接晶体管对中该P型晶体管以及该N型晶体管的储存电荷。
如权利要求11所述的延迟元件,其中该旁路单元包含数个旁路晶体管,该些旁路晶体管以并联方式或迭接方式相互耦接。
一种延迟元件,包含:
数个反向晶体管对,以交错耦接方式串联相接,并依序交错控制,且该些反向晶体管对中的第一者用以接收一输入信号;以及
数个迭接晶体管对,迭接于该些反向晶体管对之间,且该些迭接晶体管对依序串联相接,该些迭接晶体管对中的第一者交错耦接该些反向晶体管对中的最后一者,并由该些反向晶体管对中的最后一者交错控制;
其中该些反向晶体管对以及该些迭接晶体管对用以提供连续的数个信号传递延迟,且该输入信号经由该些反向晶体管对以及该些迭接晶体管对依序操作而延迟一预设太阳城集团,以产生相对应该预设太阳城集团的一输出信号。
如权利要求13所述的延迟元件,其中该些反向晶体管对以及该些迭接晶体管对中的每一者包含一P型晶体管以及一N型晶体管,且该些反向晶体管对以及该些迭接晶体管对中的该P型晶体管以及该N型晶体管以交错方式传递信号。
如权利要求14所述的延迟元件,更包含:
一旁路单元,并联耦接该些迭接晶体管对,透过切换该旁路单元至导通状态,以排除该些迭接晶体管对中该P型晶体管以及该N型晶体管的储存电荷。
如权利要求15所述的延迟元件,其中该旁路单元包含数个旁路晶体管,该些旁路晶体管以并联方式或迭接方式相互耦接。
一种数字控制振荡器,包含数个延迟元件,其中该些延迟元件中的每一者包含:
数个反向晶体管对,以交错耦接方式串联相接,并依序交错控制,且该些反向晶体管对中的第一者用以接收一输入信号;以及
数个迭接晶体管对,分别迭接于该些反向晶体管对中相对应的一者之间,且该些迭接晶体管对依序串联相接,该些迭接晶体管对中的第一者交错耦接该些反向晶体管对中的最后一者,并由该些反向晶体管对中的最后一者交错控制;
其中该些反向晶体管对以及该些迭接晶体管对用以提供连续的数个信号传递延迟,且该输入信号经由该些反向晶体管对以及该些迭接晶体管对依序操作而延迟一预设太阳城集团,以产生相对应该预设太阳城集团的一输出信号。
如权利要求17所述的数字控制振荡器,其中该些反向晶体管对以及该些迭接晶体管对中的每一者包含一P型晶体管以及一N型晶体管,且该些反向晶体管对以及该些迭接晶体管对中的该P型晶体管以及该N型晶体管以交错方式传递信号。
如权利要求18所述的数字控制振荡器,更包含:
一旁路单元,并联耦接该些迭接晶体管对,透过切换该旁路单元至导通状态,以排除该些迭接晶体管对中该P型晶体管以及该N型晶体管的储存电荷。
如权利要求19所述的数字控制振荡器,其中该旁路单元包含数个旁路晶体管,该些旁路晶体管以并联方式或迭接方式相互耦接。

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延迟 元件 数字控制 振荡器
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