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一种基于片上嵌入式微系统的SIP模块测试方法.pdf

摘要
申请专利号:

太阳城集团CN201611205402.0

申请日:

2016.12.23

公开号:

CN106814305A

公开日:

2017.06.09

当前法律状态:

实审

有效性:

审中

法律详情: 实质审查的生效IPC(主分类):G01R 31/28申请日:20161223|||公开
IPC分类号: G01R31/28; G01R31/3167; H03M1/10 主分类号: G01R31/28
申请人: 北京时代民芯科技有限公司; 北京微电子技术研究所
发明人: 郭权; 祝天瑞; 李志远; 王猛
地址: 100076 北京市丰台区东高地四营门北路2号
优先权:
专利代理机构: 中国航天科技专利中心 11009 代理人: 臧春喜
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法律状态
申请(专利)号:

太阳城集团CN201611205402.0

授权太阳城集团号:

|||

法律状态太阳城集团日:

2017.07.04|||2017.06.09

法律状态类型:

太阳城集团实质审查的生效|||公开

摘要

一种基于片上嵌入式微系统的SIP模块测试方法,首先利用SIP模块内部的CPU单元,对所有存储器单元的全部地址进行读写操作,以测试存储器单元的正确性;然后对SIP模块内部CPU单元进行内部封闭自测试和外部辅助测试,以验证CPU单元的正确性;最后通过内部CPU单元和外部FPGA对SIP模块内部FPGA进行测试。本发明方法在不提高SIP模块设计复杂度的基础上,有效的对SIP模块功能、内部互联进行测试,最大程度上满足了SIP模块全测试覆盖的需求,在保证SIP模块正确性的基础上,提高了测试效率。

权利要求书

1.一种基于片上嵌入式微系统的SIP模块测试方法,其特征在于包括下列步骤:
(1)利用SIP模块内部的CPU单元,对所有存储器单元的全部地址进行读写操作,以测试
存储器单元的正确性;
(2)对SIP模块内部CPU单元进行内部封闭自测试和外部辅助测试,以验证CPU单元的正
确性;
(3)对SIP模块内部FPGA进行以下测试:
通过外部FPGA向SIP模块内部FPGA输入时钟,并通过外部FPGA查看内部FPGA的lock信
号是否锁定,以测试内部FPGA工作频率的正确性;
采用MARCH C算法,通过CPU单元,向内部FPGA的可配置RAM的全部地址进行读写操作,
以测试可配置RAM的正确性;
晶振提供输入频率,内部FPGA进行不同程度的倍频,通过外部PPGA查看内部FPGA的
Lock信号,分别验证低频模式和高频模式下内部FPGA是否正常工作,以测试延时锁相环的
正确性。
2.根据权利要求1所述的一种基于片上嵌入式微系统的SIP模块测试方法,其特征在
于:所述SIP模块、外部FPGA以及外围电路布置在硬件测试平台上,所述硬件测试平台为SIP
模块、外部FPGA以及外围电路提供电信号、地信号、时钟信号,并实现板级互联。
3.根据权利要求1所述的一种基于片上嵌入式微系统的SIP模块测试方法,其特征在
于:所述步骤(2)中,内部封闭自测试的实现方法为:向CPU单元内部寄存器写入数据,根据
内部寄存器要实现的功能,结合逻辑判断验证从内部寄存器读出的数据是否正确;
外部辅助测试的实现方法为:通过外围电路向CPU单元输入激励,CPU单元采集或通过
外部FPGA采集输出信号,通过输入激励、输出信号以及预先设计的内部逻辑,判断CPU单元
设计是否正确。
4.根据权利要求1所述的一种基于片上嵌入式微系统的SIP模块测试方法,其特征在
于:所述步骤(1)中对所有存储器单元的全部地址进行读写操作的方法为:
(4.1)CPU单元为存储器前半部分存储空间加载代码,以实现对存储器后半部分存储空
间所有单元进行读写操作;
(4.2)更改读写周期,对存储器后半部分存储空间所有单元进行读写操作;
(4.3)CPU单元为存储器后半部分存储空间加载代码,以实现对前半部分存储空间所有
单元进行读写操作;
(4.4)更改读写周期,对存储器前半部分存储空间所有单元进行读写操作。

关 键 词:
一种 基于 嵌入 式微 系统 SIP 模块 测试 方法
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